Digital Verification Engineer (m/f/d)
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Qualifikationen

Informatik
Verifikation (Systementwicklungsaufgabe)
Master
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C++
Elektrotechnik
Künstliche Intelligenz
Python
Deutsch

Vollständige Stellenbeschreibung

Engineering the Connected Future

Wir suchen aktuell: Digital Verification Engineer (m/f/d) in München

Innovation im Fokus. Seit 1999 - profitabel, siebenfacher Wachstumschampion, Champions-League-Technologie.
lnova Semiconductors ist Pionier für High-Speed-Datenübertragung und smarte Beleuchtungslösungen im Automotive-Sektor. In München entwickeln wir die High-Tech-Lösungen für Infotainment, ADAS und das Automotive-Lichtdesign von morgen - rund 70 Mitarbeiter, die einander kennen: persönlich, sichtbar, ansprechbar.

Inova entwickelt mit APXpress das universelle High-Speed-Nervensystem für die nächste Generation von Netzwerken im Fahrzeug. Dafür suchen wir Verstärkung für unser Verifikationsteam. Unsere Verifikation ist direkt im Hardware-Entwicklungsteam verortet und operiert nicht als nachgelagerter Kontrollschritt. Die Teststrategien werden ab der Konzeptphase gemeinsam von Design- und Verifikations-Ingenieuren erarbeitet. Durch diesen kollaborativen Ansatz sichern wir komplexe Datenpfade prozessbegleitend ab und schließen Fehlerquellen systematisch während der laufenden Implementierung aus.

Wie wir zusammenarbeiten:
Wir arbeiten in einem fokussierten, lösungsorientierten und internationalen Team. Kurze Wege, schnelle Entscheidungen, direkter Draht - bis hin zur Geschäftsleitung. Während die technische Führung den strategischen Rahmen setzt, gestalten wir den Weg dorthin gemeinsam: Technische Herausforderungen besprechen wir im Team auf Augenhöhe und finden gemeinsam die besten Wege. Durch den direkten Draht zu den Design-Teams triffst du operative Entscheidungen schnell und unkompliziert, ganz ohne bürokratische Schleifen.

Als Digital Verification Engineer (m/f/d) sieht dein Alltag bei uns im Team konkret so aus

Gestalten und Weiterentwickeln: Du entwirfst neue Testbenches von Grund auf oder optimierst bestehende Umgebungen für die Module und Funktionsgruppen unserer neuesten APXpress-Produkte. Dein Werkzeug dabei: Die UVM Methodology in SystemVerilog und SystemC.
Neues dazulernen: Dein Spektrum reicht von gängigen Standards (z. B. AXI4 Full/Stream/Lite, SPI, DisplayPort oder HDCP) bis hin zu unseren eigenentwickelten Protokollen – du hast hier die perfekte Umgebung, um dein Protokoll-Wissen massiv zu vertiefen.
Systemlevel & Prototyping: Du gestaltest den Aufbau und die Erweiterung komplexer UVM System-Level-Testbenches aktiv mit. Gleichzeitig baust du mit uns das Know-how für virtuelle Prototypen auf, um die Firmware-Entwicklung frühzeitig und unabhängig von der realen Hardware zu ermöglichen.
Modell-Integration: Du integrierst Referenzmodelle und VIP-Komponenten nahtlos in unsere Testumgebungen.
Qualitätssicherung: Du behältst den Überblick bei Regressions-Simulationen, analysierst die Ergebnisse mit scharfem Blick fürs Detail und treibst das Coverage Closure aktiv voran.
Frontend Signoff & GLS: Du führst Gate-Level-Simulationen (GLS) durch und begleitest die Verifikationsaktivitäten zuverlässig bis zum erfolgreichen Frontend Signoff vor dem Tapeout.
Strategische Planung: Gemeinsam mit dem Team erstellst und pflegst du fundierte Verifikationspläne.
Teamplayer-Schnittstelle: Du arbeitest Hand in Hand mit unseren Design-Teams, um optimale Ergebnisse zu erzielen.
Hands-on im Labor: Bei der Inbetriebnahme neuer Bausteine unterstützt du uns direkt in der Laborumgebung.
Innovation: Du bringst dich aktiv ein, wenn wir unsere Verifikationskonzepte und -methoden auf das nächste Level heben.
Smarte Unterstützung: Du hilfst uns dabei, den Einsatz von KI-Assistenzsystemen (wie LLM-basierten Coding-Tools) im Verifikations-Alltag zu optimieren und so die Qualität unserer Testbenches weiter zu steigern.

Damit du dich in dieser Rolle wohlfühlst & wir gemeinsam die beste Hardware entwickeln, bringst du folgendes mit

Deine Basis: Ein abgeschlossenes Studium der Elektrotechnik, Informatik oder einer vergleichbaren Fachrichtung.
Fundierte Berufserfahrung: Du verfügst über mehrjährige (ca. 4–5 Jahre) relevante Berufserfahrung in der digitalen Verifikation im industriellen Umfeld.
Methodik & Sprachen: Du beherrschst SystemVerilog und UVM (oder vergleichbare Frameworks) sowie Constrained Random und Assertion-basierte Verifikation (SVA) sicher.
Dein Architektur-Skillset: Du hast bereits erste Erfahrung darin gesammelt, UVM-Testbenches von Grund auf („from scratch“) zu entwerfen und aufzubauen – du verstehst, wie man eine Testumgebung strukturiert und schaust gerne hinter die Kulissen bestehender Frameworks.
IT-Umgebung & Scripting: Du bewegst dich sicher in der Linux-Umgebung und nutzt Python, um deine Verifikations-Workflows effizient zu automatisieren.
Mindset: Du arbeitest analytisch, strukturiert und kommunizierst sicher auf Deutsch und Englisch.

Das rundet dein Profil ab (Nice-to-have)

Du bringst Erfahrung mit SystemC (UVM-SystemC) mit oder hast gute OOP-Kenntnisse in C++, um dich schnell in unsere Umgebungen einzuarbeiten – das ist für uns ein echtes Plus.
Du hast Kenntnisse über Datenschnittstellen (z. B. AXI) oder Videoschnittstellen (z. B. DisplayPort, HDMI, CSI).
Du kennst dich idealerweise mit der funktionalen Sicherheit (Functional Safety) und der Verifikation nach dem ISO 26262 Standard aus.

Wir bieten dir

Du arbeitest bei Deutschlands Innovationsführer in der Halbleiterindustrie, einem kontinuierlich profitabel wachsenden Unternehmen mit gesunder Basis
Ausstattung, Tools und Räume auf der Höhe der Technologie, die wir entwickeln
Weiterentwicklungspfade, die zu dir passen — fachlich wie persönlich
Du arbeitest hauptsächlich aus unseren Büroräumen in München, die Möglichkeit für Homeoffice & Workation besteht
Faire Vergütung über Branchenniveau: Was du leistest, wird gesehen und honoriert
Betriebliche Zusatzleistungen: Altersvorsorge sowie Gruppenunfall- und Auslandsreisekrankenversicherung sowohl im Dienst als auch in deiner Freizeit
Attraktive Corporate Benefits
Gemeinsame Team- und Firmenevents

Klingt das gut?
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